drivers/ata/sata_sis.c

   1 /*
   2  *  sata_sis.c - Silicon Integrated Systems SATA
   3  *
   4  *  Maintained by:  Uwe Koziolek
   5  *                  Please ALWAYS copy linux-ide@vger.kernel.org
   6  *                  on emails.
   7  *
   8  *  Copyright 2004 Uwe Koziolek
   9  *
  10  *
  11  *  This program is free software; you can redistribute it and/or modify
  12  *  it under the terms of the GNU General Public License as published by
  13  *  the Free Software Foundation; either version 2, or (at your option)
  14  *  any later version.
  15  *
  16  *  This program is distributed in the hope that it will be useful,
  17  *  but WITHOUT ANY WARRANTY; without even the implied warranty of
  18  *  MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE.  See the
  19  *  GNU General Public License for more details.
  20  *
  21  *  You should have received a copy of the GNU General Public License
  22  *  along with this program; see the file COPYING.  If not, write to
  23  *  the Free Software Foundation, 675 Mass Ave, Cambridge, MA 02139, USA.
  24  *
  25  *
  26  *  libata documentation is available via 'make {ps|pdf}docs',
  27  *  as Documentation/DocBook/libata.*
  28  *
  29  *  Hardware documentation available under NDA.
  30  *
  31  */
  32
  33 #include <linux/kernel.h>
  34 #include <linux/module.h>
  35 #include <linux/pci.h>
  36 #include <linux/init.h>
  37 #include <linux/blkdev.h>
  38 #include <linux/delay.h>
  39 #include <linux/interrupt.h>
  40 #include <linux/device.h>
  41 #include <scsi/scsi_host.h>
  42 #include <linux/libata.h>
  43
  44 #define DRV_NAME        "sata_sis"
  45 #define DRV_VERSION     "0.7"
  46
  47 enum {
  48         sis_180                 = 0,
  49         SIS_SCR_PCI_BAR         = 5,
  50
  51         /* PCI configuration registers */
  52         SIS_GENCTL              = 0x54, /* IDE General Control register */
  53         SIS_SCR_BASE            = 0xc0, /* sata0 phy SCR registers */
  54         SIS180_SATA1_OFS        = 0x10, /* offset from sata0->sata1 phy regs */
  55         SIS182_SATA1_OFS        = 0x20, /* offset from sata0->sata1 phy regs */
  56         SIS_PMR                 = 0x90, /* port mapping register */
  57         SIS_PMR_COMBINED        = 0x30,
  58
  59         /* random bits */
  60         SIS_FLAG_CFGSCR         = (1 << 30), /* host flag: SCRs via PCI cfg */
  61
  62         GENCTL_IOMAPPED_SCR     = (1 << 26), /* if set, SCRs are in IO space */
  63 };
  64
  65 static int sis_init_one (struct pci_dev *pdev, const struct pci_device_id *ent);
  66 static u32 sis_scr_read (struct ata_port *ap, unsigned int sc_reg);
  67 static void sis_scr_write (struct ata_port *ap, unsigned int sc_reg, u32 val);
  68
  69 static const struct pci_device_id sis_pci_tbl[] = {
  70         { PCI_VDEVICE(SI, 0x0180), sis_180 },           /* SiS 964/180 */
  71         { PCI_VDEVICE(SI, 0x0181), sis_180 },           /* SiS 964/180 */
  72         { PCI_VDEVICE(SI, 0x0182), sis_180 },           /* SiS 965/965L */
  73         { PCI_VDEVICE(SI, 0x0183), sis_180 },           /* SiS 965/965L */
  74         { PCI_VDEVICE(SI, 0x1182), sis_180 },           /* SiS 966/966L */
  75         { PCI_VDEVICE(SI, 0x1183), sis_180 },           /* SiS 966/966L */
  76
  77         { }     /* terminate list */
  78 };
  79
  80 static struct pci_driver sis_pci_driver = {
  81         .name                   = DRV_NAME,
  82         .id_table               = sis_pci_tbl,
  83         .probe                  = sis_init_one,
  84         .remove                 = ata_pci_remove_one,
  85 };
  86
  87 static struct scsi_host_template sis_sht = {
  88         .module                 = THIS_MODULE,
  89         .name                   = DRV_NAME,
  90         .ioctl                  = ata_scsi_ioctl,
  91         .queuecommand           = ata_scsi_queuecmd,
  92         .can_queue              = ATA_DEF_QUEUE,
  93         .this_id                = ATA_SHT_THIS_ID,
  94         .sg_tablesize           = ATA_MAX_PRD,
  95         .cmd_per_lun            = ATA_SHT_CMD_PER_LUN,
  96         .emulated               = ATA_SHT_EMULATED,
  97         .use_clustering         = ATA_SHT_USE_CLUSTERING,
  98         .proc_name              = DRV_NAME,
  99         .dma_boundary           = ATA_DMA_BOUNDARY,
 100         .slave_configure        = ata_scsi_slave_config,
 101         .slave_destroy          = ata_scsi_slave_destroy,
 102         .bios_param             = ata_std_bios_param,
 103 };
 104
 105 static const struct ata_port_operations sis_ops = {
 106         .port_disable           = ata_port_disable,
 107         .tf_load                = ata_tf_load,
 108         .tf_read                = ata_tf_read,
 109         .check_status           = ata_check_status,
 110         .exec_command           = ata_exec_command,
 111         .dev_select             = ata_std_dev_select,
 112         .bmdma_setup            = ata_bmdma_setup,
 113         .bmdma_start            = ata_bmdma_start,
 114         .bmdma_stop             = ata_bmdma_stop,
 115         .bmdma_status           = ata_bmdma_status,
 116         .qc_prep                = ata_qc_prep,
 117         .qc_issue               = ata_qc_issue_prot,
 118         .data_xfer              = ata_pio_data_xfer,
 119         .freeze                 = ata_bmdma_freeze,
 120         .thaw                   = ata_bmdma_thaw,
 121         .error_handler          = ata_bmdma_error_handler,
 122         .post_internal_cmd      = ata_bmdma_post_internal_cmd,
 123         .irq_handler            = ata_interrupt,
 124         .irq_clear              = ata_bmdma_irq_clear,
 125         .scr_read               = sis_scr_read,
 126         .scr_write              = sis_scr_write,
 127         .port_start             = ata_port_start,
 128         .port_stop              = ata_port_stop,
 129         .host_stop              = ata_host_stop,
 130 };
 131
 132 static struct ata_port_info sis_port_info = {
 133         .sht            = &sis_sht,
 134         .flags          = ATA_FLAG_SATA | ATA_FLAG_NO_LEGACY,
 135         .pio_mask       = 0x1f,
 136         .mwdma_mask     = 0x7,
 137         .udma_mask      = 0x7f,
 138         .port_ops       = &sis_ops,
 139 };
 140
 141 MODULE_AUTHOR("Uwe Koziolek");
 142 MODULE_DESCRIPTION("low-level driver for Silicon Integratad Systems SATA controller");
 143 MODULE_LICENSE("GPL");
 144 MODULE_DEVICE_TABLE(pci, sis_pci_tbl);
 145 MODULE_VERSION(DRV_VERSION);
 146
 147 static unsigned int get_scr_cfg_addr(struct ata_port *ap, unsigned int sc_reg)
 148 {
 149         struct pci_dev *pdev = to_pci_dev(ap->host->dev);
 150         unsigned int addr = SIS_SCR_BASE + (4 * sc_reg);
 151         u8 pmr;
 152
 153         if (ap->port_no)  {
 154                 switch (pdev->device) {
 155                         case 0x0180:
 156                         case 0x0181:
 157                                 pci_read_config_byte(pdev, SIS_PMR, &pmr);
 158                                 if ((pmr & SIS_PMR_COMBINED) == 0)
 159                                         addr += SIS180_SATA1_OFS;
 160                                 break;
 161
 162                         case 0x0182:
 163                         case 0x0183:
 164                         case 0x1182:
 165                         case 0x1183:
 166                                 addr += SIS182_SATA1_OFS;
 167                                 break;
 168                 }
 169         }
 170         return addr;
 171 }
 172
 173 static u32 sis_scr_cfg_read (struct ata_port *ap, unsigned int sc_reg)
 174 {
 175         struct pci_dev *pdev = to_pci_dev(ap->host->dev);
 176         unsigned int cfg_addr = get_scr_cfg_addr(ap, sc_reg);
 177         u32 val, val2 = 0;
 178         u8 pmr;
 179
 180         if (sc_reg == SCR_ERROR) /* doesn't exist in PCI cfg space */
 181                 return 0xffffffff;
 182
 183         pci_read_config_byte(pdev, SIS_PMR, &pmr);
 184
 185         pci_read_config_dword(pdev, cfg_addr, &val);
 186
 187         if ((pdev->device == 0x0182) || (pdev->device == 0x0183) || (pdev->device == 0x1182) ||
 188             (pdev->device == 0x1183) || (pmr & SIS_PMR_COMBINED))
 189                 pci_read_config_dword(pdev, cfg_addr+0x10, &val2);
 190
 191         return (val|val2) &  0xfffffffb; /* avoid problems with powerdowned ports */
 192 }
 193
 194 static void sis_scr_cfg_write (struct ata_port *ap, unsigned int sc_reg, u32 val)
 195 {
 196         struct pci_dev *pdev = to_pci_dev(ap->host->dev);
 197         unsigned int cfg_addr = get_scr_cfg_addr(ap, sc_reg);
 198         u8 pmr;
 199
 200         if (sc_reg == SCR_ERROR) /* doesn't exist in PCI cfg space */
 201                 return;
 202
 203         pci_read_config_byte(pdev, SIS_PMR, &pmr);
 204
 205         pci_write_config_dword(pdev, cfg_addr, val);
 206
 207         if ((pdev->device == 0x0182) || (pdev->device == 0x0183) || (pdev->device == 0x1182) ||
 208             (pdev->device == 0x1183) || (pmr & SIS_PMR_COMBINED))
 209                 pci_write_config_dword(pdev, cfg_addr+0x10, val);
 210 }
 211
 212 static u32 sis_scr_read (struct ata_port *ap, unsigned int sc_reg)
 213 {
 214         struct pci_dev *pdev = to_pci_dev(ap->host->dev);
 215         u32 val, val2 = 0;
 216         u8 pmr;
 217
 218         if (sc_reg > SCR_CONTROL)
 219                 return 0xffffffffU;
 220
 221         if (ap->flags & SIS_FLAG_CFGSCR)
 222                 return sis_scr_cfg_read(ap, sc_reg);
 223
 224         pci_read_config_byte(pdev, SIS_PMR, &pmr);
 225
 226         val = inl(ap->ioaddr.scr_addr + (sc_reg * 4));
 227
 228         if ((pdev->device == 0x0182) || (pdev->device == 0x0183) || (pdev->device == 0x1182) ||
 229             (pdev->device == 0x1183) || (pmr & SIS_PMR_COMBINED))
 230                 val2 = inl(ap->ioaddr.scr_addr + (sc_reg * 4) + 0x10);
 231
 232         return (val | val2) &  0xfffffffb;
 233 }
 234
 235 static void sis_scr_write (struct ata_port *ap, unsigned int sc_reg, u32 val)
 236 {
 237         struct pci_dev *pdev = to_pci_dev(ap->host->dev);
 238         u8 pmr;
 239
 240         if (sc_reg > SCR_CONTROL)
 241                 return;
 242
 243         pci_read_config_byte(pdev, SIS_PMR, &pmr);
 244
 245         if (ap->flags & SIS_FLAG_CFGSCR)
 246                 sis_scr_cfg_write(ap, sc_reg, val);
 247         else {
 248                 outl(val, ap->ioaddr.scr_addr + (sc_reg * 4));
 249                 if ((pdev->device == 0x0182) || (pdev->device == 0x0183) || (pdev->device == 0x1182) ||
 250                     (pdev->device == 0x1183) || (pmr & SIS_PMR_COMBINED))
 251                         outl(val, ap->ioaddr.scr_addr + (sc_reg * 4)+0x10);
 252         }
 253 }
 254
 255 static int sis_init_one (struct pci_dev *pdev, const struct pci_device_id *ent)
 256 {
 257         /* Provided by the PATA driver */
 258         extern struct ata_port_info sis_info133;
 259
 260         static int printed_version;
 261         struct ata_probe_ent *probe_ent = NULL;
 262         int rc;
 263         u32 genctl, val;
 264         struct ata_port_info pi = sis_port_info, *ppi[2] = { &pi, &pi };
 265         int pci_dev_busy = 0;
 266         u8 pmr;
 267         u8 port2_start = 0x20;
 268
 269         if (!printed_version++)
 270                 dev_printk(KERN_INFO, &pdev->dev, "version " DRV_VERSION "\n");
 271
 272         rc = pci_enable_device(pdev);
 273         if (rc)
 274                 return rc;
 275
 276         rc = pci_request_regions(pdev, DRV_NAME);
 277         if (rc) {
 278                 pci_dev_busy = 1;
 279                 goto err_out;
 280         }
 281
 282         rc = pci_set_dma_mask(pdev, ATA_DMA_MASK);
 283         if (rc)
 284                 goto err_out_regions;
 285         rc = pci_set_consistent_dma_mask(pdev, ATA_DMA_MASK);
 286         if (rc)
 287                 goto err_out_regions;
 288
 289         /* check and see if the SCRs are in IO space or PCI cfg space */
 290         pci_read_config_dword(pdev, SIS_GENCTL, &genctl);
 291         if ((genctl & GENCTL_IOMAPPED_SCR) == 0)
 292                 pi.flags |= SIS_FLAG_CFGSCR;
 293
 294         /* if hardware thinks SCRs are in IO space, but there are
 295          * no IO resources assigned, change to PCI cfg space.
 296          */
 297         if ((!(pi.flags & SIS_FLAG_CFGSCR)) &&
 298             ((pci_resource_start(pdev, SIS_SCR_PCI_BAR) == 0) ||
 299              (pci_resource_len(pdev, SIS_SCR_PCI_BAR) < 128))) {
 300                 genctl &= ~GENCTL_IOMAPPED_SCR;
 301                 pci_write_config_dword(pdev, SIS_GENCTL, genctl);
 302                 pi.flags |= SIS_FLAG_CFGSCR;
 303         }
 304
 305         pci_read_config_byte(pdev, SIS_PMR, &pmr);
 306         switch (ent->device) {
 307         case 0x0180:
 308         case 0x0181:
 309
 310                 /* The PATA-handling is provided by pata_sis */
 311                 switch (pmr & 0x30) {
 312                 case 0x10:
 313                         ppi[1] = &sis_info133;
 314                         break;
 315
 316                 case 0x30:
 317                         ppi[0] = &sis_info133;
 318                         break;
 319                 }
 320                 if ((pmr & SIS_PMR_COMBINED) == 0) {
 321                         dev_printk(KERN_INFO, &pdev->dev,
 322                                    "Detected SiS 180/181/964 chipset in SATA mode\n");
 323                         port2_start = 64;
 324                 } else {
 325                         dev_printk(KERN_INFO, &pdev->dev,
 326                                    "Detected SiS 180/181 chipset in combined mode\n");
 327                         port2_start=0;
 328                         pi.flags |= ATA_FLAG_SLAVE_POSS;
 329                 }
 330                 break;
 331
 332         case 0x0182:
 333         case 0x0183:
 334                 pci_read_config_dword ( pdev, 0x6C, &val);
 335                 if (val & (1L << 31)) {
 336                         dev_printk(KERN_INFO, &pdev->dev, "Detected SiS 182/965 chipset\n");
 337                         pi.flags |= ATA_FLAG_SLAVE_POSS;
 338                 } else {
 339                         dev_printk(KERN_INFO, &pdev->dev, "Detected SiS 182/965L chipset\n");
 340                 }
 341                 break;
 342
 343         case 0x1182:
 344         case 0x1183:
 345                 pci_read_config_dword(pdev, 0x64, &val);
 346                 if (val & 0x10000000) {
 347                         dev_printk(KERN_INFO, &pdev->dev, "Detected SiS 1182/1183/966L SATA controller\n");
 348                 } else {
 349                         dev_printk(KERN_INFO, &pdev->dev, "Detected SiS 1182/1183/966 SATA controller\n");
 350                         pi.flags |= ATA_FLAG_SLAVE_POSS;
 351                 }
 352                 break;
 353         }
 354
 355         probe_ent = ata_pci_init_native_mode(pdev, ppi, ATA_PORT_PRIMARY | ATA_PORT_SECONDARY);
 356         if (!probe_ent) {
 357                 rc = -ENOMEM;
 358                 goto err_out_regions;
 359         }
 360
 361         if (!(probe_ent->port_flags & SIS_FLAG_CFGSCR)) {
 362                 probe_ent->port[0].scr_addr =
 363                         pci_resource_start(pdev, SIS_SCR_PCI_BAR);
 364                 probe_ent->port[1].scr_addr =
 365                         pci_resource_start(pdev, SIS_SCR_PCI_BAR) + port2_start;
 366         }
 367
 368         pci_set_master(pdev);
 369         pci_intx(pdev, 1);
 370
 371         /* FIXME: check ata_device_add return value */
 372         ata_device_add(probe_ent);
 373         kfree(probe_ent);
 374
 375         return 0;
 376
 377 err_out_regions:
 378         pci_release_regions(pdev);
 379
 380 err_out:
 381         if (!pci_dev_busy)
 382                 pci_disable_device(pdev);
 383         return rc;
 384
 385 }
 386
 387 static int __init sis_init(void)
 388 {
 389         return pci_register_driver(&sis_pci_driver);
 390 }
 391
 392 static void __exit sis_exit(void)
 393 {
 394         pci_unregister_driver(&sis_pci_driver);
 395 }
 396
 397 module_init(sis_init);
 398 module_exit(sis_exit);