drivers/gpu/drm/nouveau/nouveau_channel.c

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  22  * DEALINGS IN THE SOFTWARE.
  23  */
  24
  25 #include "drmP.h"
  26 #include "drm.h"
  27 #include "nouveau_drv.h"
  28 #include "nouveau_drm.h"
  29 #include "nouveau_dma.h"
  30
  31 static int
  32 nouveau_channel_pushbuf_ctxdma_init(struct nouveau_channel *chan)
  33 {
  34         struct drm_device *dev = chan->dev;
  35         struct drm_nouveau_private *dev_priv = dev->dev_private;
  36         struct nouveau_bo *pb = chan->pushbuf_bo;
  37         struct nouveau_gpuobj *pushbuf = NULL;
  38         int ret = 0;
  39
  40         if (dev_priv->card_type >= NV_50) {
  41                 if (dev_priv->card_type < NV_C0) {
  42                         ret = nouveau_gpuobj_dma_new(chan,
  43                                                      NV_CLASS_DMA_IN_MEMORY, 0,
  44                                                      (1ULL << 40),
  45                                                      NV_MEM_ACCESS_RO,
  46                                                      NV_MEM_TARGET_VM,
  47                                                      &pushbuf);
  48                 }
  49                 chan->pushbuf_base = pb->bo.offset;
  50         } else
  51         if (pb->bo.mem.mem_type == TTM_PL_TT) {
  52                 ret = nouveau_gpuobj_dma_new(chan, NV_CLASS_DMA_IN_MEMORY, 0,
  53                                              dev_priv->gart_info.aper_size,
  54                                              NV_MEM_ACCESS_RO,
  55                                              NV_MEM_TARGET_GART, &pushbuf);
  56                 chan->pushbuf_base = pb->bo.mem.start << PAGE_SHIFT;
  57         } else
  58         if (dev_priv->card_type != NV_04) {
  59                 ret = nouveau_gpuobj_dma_new(chan, NV_CLASS_DMA_IN_MEMORY, 0,
  60                                              dev_priv->fb_available_size,
  61                                              NV_MEM_ACCESS_RO,
  62                                              NV_MEM_TARGET_VRAM, &pushbuf);
  63                 chan->pushbuf_base = pb->bo.mem.start << PAGE_SHIFT;
  64         } else {
  65                 /* NV04 cmdbuf hack, from original ddx.. not sure of it's
  66                  * exact reason for existing :)  PCI access to cmdbuf in
  67                  * VRAM.
  68                  */
  69                 ret = nouveau_gpuobj_dma_new(chan, NV_CLASS_DMA_IN_MEMORY,
  70                                              pci_resource_start(dev->pdev, 1),
  71                                              dev_priv->fb_available_size,
  72                                              NV_MEM_ACCESS_RO,
  73                                              NV_MEM_TARGET_PCI, &pushbuf);
  74                 chan->pushbuf_base = pb->bo.mem.start << PAGE_SHIFT;
  75         }
  76
  77         nouveau_gpuobj_ref(pushbuf, &chan->pushbuf);
  78         nouveau_gpuobj_ref(NULL, &pushbuf);
  79         return ret;
  80 }
  81
  82 static struct nouveau_bo *
  83 nouveau_channel_user_pushbuf_alloc(struct drm_device *dev)
  84 {
  85         struct nouveau_bo *pushbuf = NULL;
  86         int location, ret;
  87
  88         if (nouveau_vram_pushbuf)
  89                 location = TTM_PL_FLAG_VRAM;
  90         else
  91                 location = TTM_PL_FLAG_TT;
  92
  93         ret = nouveau_bo_new(dev, NULL, 65536, 0, location, 0, 0x0000, &pushbuf);
  94         if (ret) {
  95                 NV_ERROR(dev, "error allocating DMA push buffer: %d\n", ret);
  96                 return NULL;
  97         }
  98
  99         ret = nouveau_bo_pin(pushbuf, location);
 100         if (ret) {
 101                 NV_ERROR(dev, "error pinning DMA push buffer: %d\n", ret);
 102                 nouveau_bo_ref(NULL, &pushbuf);
 103                 return NULL;
 104         }
 105
 106         ret = nouveau_bo_map(pushbuf);
 107         if (ret) {
 108                 nouveau_bo_unpin(pushbuf);
 109                 nouveau_bo_ref(NULL, &pushbuf);
 110                 return NULL;
 111         }
 112
 113         return pushbuf;
 114 }
 115
 116 /* allocates and initializes a fifo for user space consumption */
 117 int
 118 nouveau_channel_alloc(struct drm_device *dev, struct nouveau_channel **chan_ret,
 119                       struct drm_file *file_priv,
 120                       uint32_t vram_handle, uint32_t gart_handle)
 121 {
 122         struct drm_nouveau_private *dev_priv = dev->dev_private;
 123         struct nouveau_fifo_engine *pfifo = &dev_priv->engine.fifo;
 124         struct nouveau_channel *chan;
 125         unsigned long flags;
 126         int ret;
 127
 128         /* allocate and lock channel structure */
 129         chan = kzalloc(sizeof(*chan), GFP_KERNEL);
 130         if (!chan)
 131                 return -ENOMEM;
 132         chan->dev = dev;
 133         chan->file_priv = file_priv;
 134         chan->vram_handle = vram_handle;
 135         chan->gart_handle = gart_handle;
 136
 137         kref_init(&chan->ref);
 138         atomic_set(&chan->users, 1);
 139         mutex_init(&chan->mutex);
 140         mutex_lock(&chan->mutex);
 141
 142         /* allocate hw channel id */
 143         spin_lock_irqsave(&dev_priv->channels.lock, flags);
 144         for (chan->id = 0; chan->id < pfifo->channels; chan->id++) {
 145                 if (!dev_priv->channels.ptr[chan->id]) {
 146                         nouveau_channel_ref(chan, &dev_priv->channels.ptr[chan->id]);
 147                         break;
 148                 }
 149         }
 150         spin_unlock_irqrestore(&dev_priv->channels.lock, flags);
 151
 152         if (chan->id == pfifo->channels) {
 153                 mutex_unlock(&chan->mutex);
 154                 kfree(chan);
 155                 return -ENODEV;
 156         }
 157
 158         NV_DEBUG(dev, "initialising channel %d\n", chan->id);
 159         INIT_LIST_HEAD(&chan->nvsw.vbl_wait);
 160         INIT_LIST_HEAD(&chan->nvsw.flip);
 161         INIT_LIST_HEAD(&chan->fence.pending);
 162
 163         /* Allocate DMA push buffer */
 164         chan->pushbuf_bo = nouveau_channel_user_pushbuf_alloc(dev);
 165         if (!chan->pushbuf_bo) {
 166                 ret = -ENOMEM;
 167                 NV_ERROR(dev, "pushbuf %d\n", ret);
 168                 nouveau_channel_put(&chan);
 169                 return ret;
 170         }
 171
 172         nouveau_dma_pre_init(chan);
 173         chan->user_put = 0x40;
 174         chan->user_get = 0x44;
 175
 176         /* Allocate space for per-channel fixed notifier memory */
 177         ret = nouveau_notifier_init_channel(chan);
 178         if (ret) {
 179                 NV_ERROR(dev, "ntfy %d\n", ret);
 180                 nouveau_channel_put(&chan);
 181                 return ret;
 182         }
 183
 184         /* Setup channel's default objects */
 185         ret = nouveau_gpuobj_channel_init(chan, vram_handle, gart_handle);
 186         if (ret) {
 187                 NV_ERROR(dev, "gpuobj %d\n", ret);
 188                 nouveau_channel_put(&chan);
 189                 return ret;
 190         }
 191
 192         /* Create a dma object for the push buffer */
 193         ret = nouveau_channel_pushbuf_ctxdma_init(chan);
 194         if (ret) {
 195                 NV_ERROR(dev, "pbctxdma %d\n", ret);
 196                 nouveau_channel_put(&chan);
 197                 return ret;
 198         }
 199
 200         /* disable the fifo caches */
 201         pfifo->reassign(dev, false);
 202
 203         /* Construct initial RAMFC for new channel */
 204         ret = pfifo->create_context(chan);
 205         if (ret) {
 206                 nouveau_channel_put(&chan);
 207                 return ret;
 208         }
 209
 210         pfifo->reassign(dev, true);
 211
 212         ret = nouveau_dma_init(chan);
 213         if (!ret)
 214                 ret = nouveau_fence_channel_init(chan);
 215         if (ret) {
 216                 nouveau_channel_put(&chan);
 217                 return ret;
 218         }
 219
 220         nouveau_debugfs_channel_init(chan);
 221
 222         NV_DEBUG(dev, "channel %d initialised\n", chan->id);
 223         *chan_ret = chan;
 224         return 0;
 225 }
 226
 227 struct nouveau_channel *
 228 nouveau_channel_get_unlocked(struct nouveau_channel *ref)
 229 {
 230         struct nouveau_channel *chan = NULL;
 231
 232         if (likely(ref && atomic_inc_not_zero(&ref->users)))
 233                 nouveau_channel_ref(ref, &chan);
 234
 235         return chan;
 236 }
 237
 238 struct nouveau_channel *
 239 nouveau_channel_get(struct drm_device *dev, struct drm_file *file_priv, int id)
 240 {
 241         struct drm_nouveau_private *dev_priv = dev->dev_private;
 242         struct nouveau_channel *chan;
 243         unsigned long flags;
 244
 245         if (unlikely(id < 0 || id >= NOUVEAU_MAX_CHANNEL_NR))
 246                 return ERR_PTR(-EINVAL);
 247
 248         spin_lock_irqsave(&dev_priv->channels.lock, flags);
 249         chan = nouveau_channel_get_unlocked(dev_priv->channels.ptr[id]);
 250         spin_unlock_irqrestore(&dev_priv->channels.lock, flags);
 251
 252         if (unlikely(!chan))
 253                 return ERR_PTR(-EINVAL);
 254
 255         if (unlikely(file_priv && chan->file_priv != file_priv)) {
 256                 nouveau_channel_put_unlocked(&chan);
 257                 return ERR_PTR(-EINVAL);
 258         }
 259
 260         mutex_lock(&chan->mutex);
 261         return chan;
 262 }
 263
 264 void
 265 nouveau_channel_put_unlocked(struct nouveau_channel **pchan)
 266 {
 267         struct nouveau_channel *chan = *pchan;
 268         struct drm_device *dev = chan->dev;
 269         struct drm_nouveau_private *dev_priv = dev->dev_private;
 270         struct nouveau_fifo_engine *pfifo = &dev_priv->engine.fifo;
 271         struct nouveau_pgraph_engine *pgraph = &dev_priv->engine.graph;
 272         unsigned long flags;
 273         int i;
 274
 275         /* decrement the refcount, and we're done if there's still refs */
 276         if (likely(!atomic_dec_and_test(&chan->users))) {
 277                 nouveau_channel_ref(NULL, pchan);
 278                 return;
 279         }
 280
 281         /* no one wants the channel anymore */
 282         NV_DEBUG(dev, "freeing channel %d\n", chan->id);
 283         nouveau_debugfs_channel_fini(chan);
 284
 285         /* give it chance to idle */
 286         nouveau_channel_idle(chan);
 287
 288         /* ensure all outstanding fences are signaled.  they should be if the
 289          * above attempts at idling were OK, but if we failed this'll tell TTM
 290          * we're done with the buffers.
 291          */
 292         nouveau_fence_channel_fini(chan);
 293
 294         /* boot it off the hardware */
 295         pfifo->reassign(dev, false);
 296
 297         /* We want to give pgraph a chance to idle and get rid of all
 298          * potential errors. We need to do this without the context
 299          * switch lock held, otherwise the irq handler is unable to
 300          * process them.
 301          */
 302         if (pgraph->channel(dev) == chan)
 303                 nouveau_wait_for_idle(dev);
 304
 305         /* destroy the engine specific contexts */
 306         pfifo->destroy_context(chan);
 307         if (pgraph->destroy_context)
 308                 pgraph->destroy_context(chan);
 309         for (i = 0; i < NVOBJ_ENGINE_NR; i++) {
 310                 if (chan->engctx[i])
 311                         dev_priv->eng[i]->context_del(chan, i);
 312         }
 313
 314         pfifo->reassign(dev, true);
 315
 316         /* aside from its resources, the channel should now be dead,
 317          * remove it from the channel list
 318          */
 319         spin_lock_irqsave(&dev_priv->channels.lock, flags);
 320         nouveau_channel_ref(NULL, &dev_priv->channels.ptr[chan->id]);
 321         spin_unlock_irqrestore(&dev_priv->channels.lock, flags);
 322
 323         /* destroy any resources the channel owned */
 324         nouveau_gpuobj_ref(NULL, &chan->pushbuf);
 325         if (chan->pushbuf_bo) {
 326                 nouveau_bo_unmap(chan->pushbuf_bo);
 327                 nouveau_bo_unpin(chan->pushbuf_bo);
 328                 nouveau_bo_ref(NULL, &chan->pushbuf_bo);
 329         }
 330         nouveau_gpuobj_channel_takedown(chan);
 331         nouveau_notifier_takedown_channel(chan);
 332
 333         nouveau_channel_ref(NULL, pchan);
 334 }
 335
 336 void
 337 nouveau_channel_put(struct nouveau_channel **pchan)
 338 {
 339         mutex_unlock(&(*pchan)->mutex);
 340         nouveau_channel_put_unlocked(pchan);
 341 }
 342
 343 static void
 344 nouveau_channel_del(struct kref *ref)
 345 {
 346         struct nouveau_channel *chan =
 347                 container_of(ref, struct nouveau_channel, ref);
 348
 349         kfree(chan);
 350 }
 351
 352 void
 353 nouveau_channel_ref(struct nouveau_channel *chan,
 354                     struct nouveau_channel **pchan)
 355 {
 356         if (chan)
 357                 kref_get(&chan->ref);
 358
 359         if (*pchan)
 360                 kref_put(&(*pchan)->ref, nouveau_channel_del);
 361
 362         *pchan = chan;
 363 }
 364
 365 void
 366 nouveau_channel_idle(struct nouveau_channel *chan)
 367 {
 368         struct drm_device *dev = chan->dev;
 369         struct nouveau_fence *fence = NULL;
 370         int ret;
 371
 372         nouveau_fence_update(chan);
 373
 374         if (chan->fence.sequence != chan->fence.sequence_ack) {
 375                 ret = nouveau_fence_new(chan, &fence, true);
 376                 if (!ret) {
 377                         ret = nouveau_fence_wait(fence, false, false);
 378                         nouveau_fence_unref(&fence);
 379                 }
 380
 381                 if (ret)
 382                         NV_ERROR(dev, "Failed to idle channel %d.\n", chan->id);
 383         }
 384 }
 385
 386 /* cleans up all the fifos from file_priv */
 387 void
 388 nouveau_channel_cleanup(struct drm_device *dev, struct drm_file *file_priv)
 389 {
 390         struct drm_nouveau_private *dev_priv = dev->dev_private;
 391         struct nouveau_engine *engine = &dev_priv->engine;
 392         struct nouveau_channel *chan;
 393         int i;
 394
 395         NV_DEBUG(dev, "clearing FIFO enables from file_priv\n");
 396         for (i = 0; i < engine->fifo.channels; i++) {
 397                 chan = nouveau_channel_get(dev, file_priv, i);
 398                 if (IS_ERR(chan))
 399                         continue;
 400
 401                 atomic_dec(&chan->users);
 402                 nouveau_channel_put(&chan);
 403         }
 404 }
 405
 406
 407 /***********************************
 408  * ioctls wrapping the functions
 409  ***********************************/
 410
 411 static int
 412 nouveau_ioctl_fifo_alloc(struct drm_device *dev, void *data,
 413                          struct drm_file *file_priv)
 414 {
 415         struct drm_nouveau_private *dev_priv = dev->dev_private;
 416         struct drm_nouveau_channel_alloc *init = data;
 417         struct nouveau_channel *chan;
 418         int ret;
 419
 420         if (dev_priv->engine.graph.accel_blocked)
 421                 return -ENODEV;
 422
 423         if (init->fb_ctxdma_handle == ~0 || init->tt_ctxdma_handle == ~0)
 424                 return -EINVAL;
 425
 426         ret = nouveau_channel_alloc(dev, &chan, file_priv,
 427                                     init->fb_ctxdma_handle,
 428                                     init->tt_ctxdma_handle);
 429         if (ret)
 430                 return ret;
 431         init->channel  = chan->id;
 432
 433         if (chan->dma.ib_max)
 434                 init->pushbuf_domains = NOUVEAU_GEM_DOMAIN_VRAM |
 435                                         NOUVEAU_GEM_DOMAIN_GART;
 436         else if (chan->pushbuf_bo->bo.mem.mem_type == TTM_PL_VRAM)
 437                 init->pushbuf_domains = NOUVEAU_GEM_DOMAIN_VRAM;
 438         else
 439                 init->pushbuf_domains = NOUVEAU_GEM_DOMAIN_GART;
 440
 441         if (dev_priv->card_type < NV_C0) {
 442                 init->subchan[0].handle = NvM2MF;
 443                 if (dev_priv->card_type < NV_50)
 444                         init->subchan[0].grclass = 0x0039;
 445                 else
 446                         init->subchan[0].grclass = 0x5039;
 447                 init->subchan[1].handle = NvSw;
 448                 init->subchan[1].grclass = NV_SW;
 449                 init->nr_subchan = 2;
 450         } else {
 451                 init->subchan[0].handle  = 0x9039;
 452                 init->subchan[0].grclass = 0x9039;
 453                 init->nr_subchan = 1;
 454         }
 455
 456         /* Named memory object area */
 457         ret = drm_gem_handle_create(file_priv, chan->notifier_bo->gem,
 458                                     &init->notifier_handle);
 459
 460         if (ret == 0)
 461                 atomic_inc(&chan->users); /* userspace reference */
 462         nouveau_channel_put(&chan);
 463         return ret;
 464 }
 465
 466 static int
 467 nouveau_ioctl_fifo_free(struct drm_device *dev, void *data,
 468                         struct drm_file *file_priv)
 469 {
 470         struct drm_nouveau_channel_free *req = data;
 471         struct nouveau_channel *chan;
 472
 473         chan = nouveau_channel_get(dev, file_priv, req->channel);
 474         if (IS_ERR(chan))
 475                 return PTR_ERR(chan);
 476
 477         atomic_dec(&chan->users);
 478         nouveau_channel_put(&chan);
 479         return 0;
 480 }
 481
 482 /***********************************
 483  * finally, the ioctl table
 484  ***********************************/
 485
 486 struct drm_ioctl_desc nouveau_ioctls[] = {
 487         DRM_IOCTL_DEF_DRV(NOUVEAU_GETPARAM, nouveau_ioctl_getparam, DRM_UNLOCKED|DRM_AUTH),
 488         DRM_IOCTL_DEF_DRV(NOUVEAU_SETPARAM, nouveau_ioctl_setparam, DRM_UNLOCKED|DRM_AUTH|DRM_MASTER|DRM_ROOT_ONLY),
 489         DRM_IOCTL_DEF_DRV(NOUVEAU_CHANNEL_ALLOC, nouveau_ioctl_fifo_alloc, DRM_UNLOCKED|DRM_AUTH),
 490         DRM_IOCTL_DEF_DRV(NOUVEAU_CHANNEL_FREE, nouveau_ioctl_fifo_free, DRM_UNLOCKED|DRM_AUTH),
 491         DRM_IOCTL_DEF_DRV(NOUVEAU_GROBJ_ALLOC, nouveau_ioctl_grobj_alloc, DRM_UNLOCKED|DRM_AUTH),
 492         DRM_IOCTL_DEF_DRV(NOUVEAU_NOTIFIEROBJ_ALLOC, nouveau_ioctl_notifier_alloc, DRM_UNLOCKED|DRM_AUTH),
 493         DRM_IOCTL_DEF_DRV(NOUVEAU_GPUOBJ_FREE, nouveau_ioctl_gpuobj_free, DRM_UNLOCKED|DRM_AUTH),
 494         DRM_IOCTL_DEF_DRV(NOUVEAU_GEM_NEW, nouveau_gem_ioctl_new, DRM_UNLOCKED|DRM_AUTH),
 495         DRM_IOCTL_DEF_DRV(NOUVEAU_GEM_PUSHBUF, nouveau_gem_ioctl_pushbuf, DRM_UNLOCKED|DRM_AUTH),
 496         DRM_IOCTL_DEF_DRV(NOUVEAU_GEM_CPU_PREP, nouveau_gem_ioctl_cpu_prep, DRM_UNLOCKED|DRM_AUTH),
 497         DRM_IOCTL_DEF_DRV(NOUVEAU_GEM_CPU_FINI, nouveau_gem_ioctl_cpu_fini, DRM_UNLOCKED|DRM_AUTH),
 498         DRM_IOCTL_DEF_DRV(NOUVEAU_GEM_INFO, nouveau_gem_ioctl_info, DRM_UNLOCKED|DRM_AUTH),
 499 };
 500
 501 int nouveau_max_ioctl = DRM_ARRAY_SIZE(nouveau_ioctls);