cpu/mpc83xx/speed.c

   1 /*
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   3  * Wolfgang Denk, DENX Software Engineering, wd@denx.de.
   4  *
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   6  *
   7  * See file CREDITS for list of people who contributed to this
   8  * project.
   9  *
  10  * This program is free software; you can redistribute it and/or
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  21  * along with this program; if not, write to the Free Software
  22  * Foundation, Inc., 59 Temple Place, Suite 330, Boston,
  23  * MA 02111-1307 USA
  24  *
  25  * Change log:
  26  *
  27  * 20050101: Eran Liberty (liberty@freescale.com)
  28  *           Initial file creating (porting from 85XX & 8260)
  29  */
  30
  31 #include <common.h>
  32 #include <mpc83xx.h>
  33 #include <asm/processor.h>
  34
  35 DECLARE_GLOBAL_DATA_PTR;
  36
  37 /* ----------------------------------------------------------------- */
  38
  39 typedef enum {
  40         _unk,
  41         _off,
  42         _byp,
  43         _x8,
  44         _x4,
  45         _x2,
  46         _x1,
  47         _1x,
  48         _1_5x,
  49         _2x,
  50         _2_5x,
  51         _3x
  52 } mult_t;
  53
  54 typedef struct {
  55         mult_t core_csb_ratio;
  56         mult_t vco_divider;
  57 } corecnf_t;
  58
  59 corecnf_t corecnf_tab[] = {
  60         {_byp, _byp},           /* 0x00 */
  61         {_byp, _byp},           /* 0x01 */
  62         {_byp, _byp},           /* 0x02 */
  63         {_byp, _byp},           /* 0x03 */
  64         {_byp, _byp},           /* 0x04 */
  65         {_byp, _byp},           /* 0x05 */
  66         {_byp, _byp},           /* 0x06 */
  67         {_byp, _byp},           /* 0x07 */
  68         {_1x, _x2},             /* 0x08 */
  69         {_1x, _x4},             /* 0x09 */
  70         {_1x, _x8},             /* 0x0A */
  71         {_1x, _x8},             /* 0x0B */
  72         {_1_5x, _x2},           /* 0x0C */
  73         {_1_5x, _x4},           /* 0x0D */
  74         {_1_5x, _x8},           /* 0x0E */
  75         {_1_5x, _x8},           /* 0x0F */
  76         {_2x, _x2},             /* 0x10 */
  77         {_2x, _x4},             /* 0x11 */
  78         {_2x, _x8},             /* 0x12 */
  79         {_2x, _x8},             /* 0x13 */
  80         {_2_5x, _x2},           /* 0x14 */
  81         {_2_5x, _x4},           /* 0x15 */
  82         {_2_5x, _x8},           /* 0x16 */
  83         {_2_5x, _x8},           /* 0x17 */
  84         {_3x, _x2},             /* 0x18 */
  85         {_3x, _x4},             /* 0x19 */
  86         {_3x, _x8},             /* 0x1A */
  87         {_3x, _x8},             /* 0x1B */
  88 };
  89
  90 /* ----------------------------------------------------------------- */
  91
  92 /*
  93  *
  94  */
  95 int get_clocks(void)
  96 {
  97         volatile immap_t *im = (immap_t *) CFG_IMMR;
  98         u32 pci_sync_in;
  99         u8 spmf;
 100         u8 clkin_div;
 101         u32 sccr;
 102         u32 corecnf_tab_index;
 103         u8 corepll;
 104         u32 lcrr;
 105
 106         u32 csb_clk;
 107 #if defined(CONFIG_MPC8349)
 108         u32 tsec1_clk;
 109         u32 tsec2_clk;
 110         u32 usbmph_clk;
 111         u32 usbdr_clk;
 112 #endif
 113         u32 core_clk;
 114         u32 i2c1_clk;
 115         u32 i2c2_clk;
 116         u32 enc_clk;
 117         u32 lbiu_clk;
 118         u32 lclk_clk;
 119         u32 ddr_clk;
 120 #if defined (CONFIG_MPC8360)
 121         u32 qepmf;
 122         u32 qepdf;
 123         u32 ddr_sec_clk;
 124         u32 qe_clk;
 125         u32 brg_clk;
 126 #endif
 127
 128         if ((im->sysconf.immrbar & IMMRBAR_BASE_ADDR) != (u32) im)
 129                 return -1;
 130
 131         clkin_div = ((im->clk.spmr & SPMR_CKID) >> SPMR_CKID_SHIFT);
 132
 133         if (im->reset.rcwh & HRCWH_PCI_HOST) {
 134 #if defined(CONFIG_83XX_CLKIN)
 135                 pci_sync_in = CONFIG_83XX_CLKIN / (1 + clkin_div);
 136 #else
 137                 pci_sync_in = 0xDEADBEEF;
 138 #endif
 139         } else {
 140 #if defined(CONFIG_83XX_PCICLK)
 141                 pci_sync_in = CONFIG_83XX_PCICLK;
 142 #else
 143                 pci_sync_in = 0xDEADBEEF;
 144 #endif
 145         }
 146
 147         spmf = ((im->reset.rcwl & RCWL_SPMF) >> RCWL_SPMF_SHIFT);
 148         csb_clk = pci_sync_in * (1 + clkin_div) * spmf;
 149
 150         sccr = im->clk.sccr;
 151
 152 #if defined(CONFIG_MPC8349)
 153         switch ((sccr & SCCR_TSEC1CM) >> SCCR_TSEC1CM_SHIFT) {
 154         case 0:
 155                 tsec1_clk = 0;
 156                 break;
 157         case 1:
 158                 tsec1_clk = csb_clk;
 159                 break;
 160         case 2:
 161                 tsec1_clk = csb_clk / 2;
 162                 break;
 163         case 3:
 164                 tsec1_clk = csb_clk / 3;
 165                 break;
 166         default:
 167                 /* unkown SCCR_TSEC1CM value */
 168                 return -4;
 169         }
 170
 171         switch ((sccr & SCCR_TSEC2CM) >> SCCR_TSEC2CM_SHIFT) {
 172         case 0:
 173                 tsec2_clk = 0;
 174                 break;
 175         case 1:
 176                 tsec2_clk = csb_clk;
 177                 break;
 178         case 2:
 179                 tsec2_clk = csb_clk / 2;
 180                 break;
 181         case 3:
 182                 tsec2_clk = csb_clk / 3;
 183                 break;
 184         default:
 185                 /* unkown SCCR_TSEC2CM value */
 186                 return -5;
 187         }
 188
 189         i2c1_clk = tsec2_clk;
 190
 191         switch ((sccr & SCCR_USBMPHCM) >> SCCR_USBMPHCM_SHIFT) {
 192         case 0:
 193                 usbmph_clk = 0;
 194                 break;
 195         case 1:
 196                 usbmph_clk = csb_clk;
 197                 break;
 198         case 2:
 199                 usbmph_clk = csb_clk / 2;
 200                 break;
 201         case 3:
 202                 usbmph_clk = csb_clk / 3;
 203                 break;
 204         default:
 205                 /* unkown SCCR_USBMPHCM value */
 206                 return -7;
 207         }
 208
 209         switch ((sccr & SCCR_USBDRCM) >> SCCR_USBDRCM_SHIFT) {
 210         case 0:
 211                 usbdr_clk = 0;
 212                 break;
 213         case 1:
 214                 usbdr_clk = csb_clk;
 215                 break;
 216         case 2:
 217                 usbdr_clk = csb_clk / 2;
 218                 break;
 219         case 3:
 220                 usbdr_clk = csb_clk / 3;
 221                 break;
 222         default:
 223                 /* unkown SCCR_USBDRCM value */
 224                 return -8;
 225         }
 226
 227         if (usbmph_clk != 0 && usbdr_clk != 0 && usbmph_clk != usbdr_clk) {
 228                 /* if USB MPH clock is not disabled and
 229                  * USB DR clock is not disabled then
 230                  * USB MPH & USB DR must have the same rate
 231                  */
 232                 return -9;
 233         }
 234 #endif
 235 #if defined (CONFIG_MPC8360)
 236         i2c1_clk = csb_clk;
 237 #endif
 238         i2c2_clk = csb_clk;     /* i2c-2 clk is equal to csb clk */
 239
 240         switch ((sccr & SCCR_ENCCM) >> SCCR_ENCCM_SHIFT) {
 241         case 0:
 242                 enc_clk = 0;
 243                 break;
 244         case 1:
 245                 enc_clk = csb_clk;
 246                 break;
 247         case 2:
 248                 enc_clk = csb_clk / 2;
 249                 break;
 250         case 3:
 251                 enc_clk = csb_clk / 3;
 252                 break;
 253         default:
 254                 /* unkown SCCR_ENCCM value */
 255                 return -6;
 256         }
 257 #if defined(CONFIG_MPC8349) || defined(CONFIG_MPC8360)
 258         lbiu_clk = csb_clk *
 259                    (1 + ((im->reset.rcwl & RCWL_LBIUCM) >> RCWL_LBIUCM_SHIFT));
 260 #else
 261 #error Unknown MPC83xx chip
 262 #endif
 263         lcrr = (im->lbus.lcrr & LCRR_CLKDIV) >> LCRR_CLKDIV_SHIFT;
 264         switch (lcrr) {
 265         case 2:
 266         case 4:
 267         case 8:
 268                 lclk_clk = lbiu_clk / lcrr;
 269                 break;
 270         default:
 271                 /* unknown lcrr */
 272                 return -10;
 273         }
 274 #if defined(CONFIG_MPC8349) || defined(CONFIG_MPC8360)
 275         ddr_clk = csb_clk *
 276                   (1 + ((im->reset.rcwl & RCWL_DDRCM) >> RCWL_DDRCM_SHIFT));
 277         corepll = (im->reset.rcwl & RCWL_COREPLL) >> RCWL_COREPLL_SHIFT;
 278 #if defined (CONFIG_MPC8360)
 279         ddr_sec_clk = csb_clk * (1 +
 280                        ((im->reset.rcwl & RCWL_LBIUCM) >> RCWL_LBIUCM_SHIFT));
 281 #endif
 282 #else
 283 #error Unknown MPC83xx chip
 284 #endif
 285
 286         corecnf_tab_index = ((corepll & 0x1F) << 2) | ((corepll & 0x60) >> 5);
 287         if (corecnf_tab_index > (sizeof(corecnf_tab) / sizeof(corecnf_t))) {
 288                 /* corecnf_tab_index is too high, possibly worng value */
 289                 return -11;
 290         }
 291         switch (corecnf_tab[corecnf_tab_index].core_csb_ratio) {
 292         case _byp:
 293         case _x1:
 294         case _1x:
 295                 core_clk = csb_clk;
 296                 break;
 297         case _1_5x:
 298                 core_clk = (3 * csb_clk) / 2;
 299                 break;
 300         case _2x:
 301                 core_clk = 2 * csb_clk;
 302                 break;
 303         case _2_5x:
 304                 core_clk = (5 * csb_clk) / 2;
 305                 break;
 306         case _3x:
 307                 core_clk = 3 * csb_clk;
 308                 break;
 309         default:
 310                 /* unkown core to csb ratio */
 311                 return -12;
 312         }
 313
 314 #if defined (CONFIG_MPC8360)
 315         qepmf = (im->reset.rcwl & RCWL_CEPMF) >> RCWL_CEPMF_SHIFT;
 316         qepdf = (im->reset.rcwl & RCWL_CEPDF) >> RCWL_CEPDF_SHIFT;
 317         qe_clk = (pci_sync_in * qepmf) / (1 + qepdf);
 318         brg_clk = qe_clk / 2;
 319 #endif
 320
 321         gd->csb_clk = csb_clk;
 322 #if defined(CONFIG_MPC8349)
 323         gd->tsec1_clk = tsec1_clk;
 324         gd->tsec2_clk = tsec2_clk;
 325         gd->usbmph_clk = usbmph_clk;
 326         gd->usbdr_clk = usbdr_clk;
 327 #endif
 328         gd->core_clk = core_clk;
 329         gd->i2c1_clk = i2c1_clk;
 330         gd->i2c2_clk = i2c2_clk;
 331         gd->enc_clk = enc_clk;
 332         gd->lbiu_clk = lbiu_clk;
 333         gd->lclk_clk = lclk_clk;
 334         gd->ddr_clk = ddr_clk;
 335 #if defined (CONFIG_MPC8360)
 336         gd->ddr_sec_clk = ddr_sec_clk;
 337         gd->qe_clk = qe_clk;
 338         gd->brg_clk = brg_clk;
 339 #endif
 340         gd->cpu_clk = gd->core_clk;
 341         gd->bus_clk = gd->csb_clk;
 342         return 0;
 343
 344 }
 345
 346 ulong get_ddr_clk(ulong dummy)
 347 {
 348         return gd->ddr_clk;
 349 }
 350
 351 /********************************************
 352  * get_bus_freq
 353  * return system bus freq in Hz
 354  *********************************************/
 355 ulong get_bus_freq(ulong dummy)
 356 {
 357         return gd->csb_clk;
 358 }
 359
 360 int print_clock_conf(void)
 361 {
 362         printf("Clock configuration:\n");
 363         printf("  Coherent System Bus: %4d MHz\n", gd->csb_clk / 1000000);
 364         printf("  Core:                %4d MHz\n", gd->core_clk / 1000000);
 365 #if defined (CONFIG_MPC8360)
 366         printf("  QE:                  %4d MHz\n", gd->qe_clk / 1000000);
 367 #endif
 368         printf("  Local Bus Controller:%4d MHz\n", gd->lbiu_clk / 1000000);
 369         printf("  Local Bus:           %4d MHz\n", gd->lclk_clk / 1000000);
 370         printf("  DDR:                 %4d MHz\n", gd->ddr_clk / 1000000);
 371 #if defined (CONFIG_MPC8360)
 372         printf("  DDR Secondary:       %4d MHz\n", gd->ddr_sec_clk / 1000000);
 373 #endif
 374         printf("  SEC:                 %4d MHz\n", gd->enc_clk / 1000000);
 375         printf("  I2C1:                %4d MHz\n", gd->i2c1_clk / 1000000);
 376         printf("  I2C2:                %4d MHz\n", gd->i2c2_clk / 1000000);
 377 #if defined(CONFIG_MPC8349)
 378         printf("  TSEC1:               %4d MHz\n", gd->tsec1_clk / 1000000);
 379         printf("  TSEC2:               %4d MHz\n", gd->tsec2_clk / 1000000);
 380         printf("  USB MPH:             %4d MHz\n", gd->usbmph_clk / 1000000);
 381         printf("  USB DR:              %4d MHz\n", gd->usbdr_clk / 1000000);
 382 #endif
 383         return 0;
 384 }