arch/parisc/kernel/irq.c

   1 /*
   2  * Code to handle x86 style IRQs plus some generic interrupt stuff.
   3  *
   4  * Copyright (C) 1992 Linus Torvalds
   5  * Copyright (C) 1994, 1995, 1996, 1997, 1998 Ralf Baechle
   6  * Copyright (C) 1999 SuSE GmbH (Philipp Rumpf, prumpf@tux.org)
   7  * Copyright (C) 1999-2000 Grant Grundler
   8  * Copyright (c) 2005 Matthew Wilcox
   9  *
  10  *    This program is free software; you can redistribute it and/or modify
  11  *    it under the terms of the GNU General Public License as published by
  12  *    the Free Software Foundation; either version 2, or (at your option)
  13  *    any later version.
  14  *
  15  *    This program is distributed in the hope that it will be useful,
  16  *    but WITHOUT ANY WARRANTY; without even the implied warranty of
  17  *    MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE.  See the
  18  *    GNU General Public License for more details.
  19  *
  20  *    You should have received a copy of the GNU General Public License
  21  *    along with this program; if not, write to the Free Software
  22  *    Foundation, Inc., 675 Mass Ave, Cambridge, MA 02139, USA.
  23  */
  24 #include <linux/bitops.h>
  25 #include <linux/errno.h>
  26 #include <linux/init.h>
  27 #include <linux/interrupt.h>
  28 #include <linux/kernel_stat.h>
  29 #include <linux/seq_file.h>
  30 #include <linux/spinlock.h>
  31 #include <linux/types.h>
  32 #include <asm/io.h>
  33
  34 #include <asm/smp.h>
  35
  36 #undef PARISC_IRQ_CR16_COUNTS
  37
  38 extern irqreturn_t timer_interrupt(int, void *);
  39 extern irqreturn_t ipi_interrupt(int, void *);
  40
  41 #define EIEM_MASK(irq)       (1UL<<(CPU_IRQ_MAX - irq))
  42
  43 /* Bits in EIEM correlate with cpu_irq_action[].
  44 ** Numbered *Big Endian*! (ie bit 0 is MSB)
  45 */
  46 static volatile unsigned long cpu_eiem = 0;
  47
  48 /*
  49 ** local ACK bitmap ... habitually set to 1, but reset to zero
  50 ** between ->ack() and ->end() of the interrupt to prevent
  51 ** re-interruption of a processing interrupt.
  52 */
  53 static DEFINE_PER_CPU(unsigned long, local_ack_eiem) = ~0UL;
  54
  55 static void cpu_mask_irq(struct irq_data *d)
  56 {
  57         unsigned long eirr_bit = EIEM_MASK(d->irq);
  58
  59         cpu_eiem &= ~eirr_bit;
  60         /* Do nothing on the other CPUs.  If they get this interrupt,
  61          * The & cpu_eiem in the do_cpu_irq_mask() ensures they won't
  62          * handle it, and the set_eiem() at the bottom will ensure it
  63          * then gets disabled */
  64 }
  65
  66 static void __cpu_unmask_irq(unsigned int irq)
  67 {
  68         unsigned long eirr_bit = EIEM_MASK(irq);
  69
  70         cpu_eiem |= eirr_bit;
  71
  72         /* This is just a simple NOP IPI.  But what it does is cause
  73          * all the other CPUs to do a set_eiem(cpu_eiem) at the end
  74          * of the interrupt handler */
  75         smp_send_all_nop();
  76 }
  77
  78 static void cpu_unmask_irq(struct irq_data *d)
  79 {
  80         __cpu_unmask_irq(d->irq);
  81 }
  82
  83 void cpu_ack_irq(struct irq_data *d)
  84 {
  85         unsigned long mask = EIEM_MASK(d->irq);
  86         int cpu = smp_processor_id();
  87
  88         /* Clear in EIEM so we can no longer process */
  89         per_cpu(local_ack_eiem, cpu) &= ~mask;
  90
  91         /* disable the interrupt */
  92         set_eiem(cpu_eiem & per_cpu(local_ack_eiem, cpu));
  93
  94         /* and now ack it */
  95         mtctl(mask, 23);
  96 }
  97
  98 void cpu_eoi_irq(struct irq_data *d)
  99 {
 100         unsigned long mask = EIEM_MASK(d->irq);
 101         int cpu = smp_processor_id();
 102
 103         /* set it in the eiems---it's no longer in process */
 104         per_cpu(local_ack_eiem, cpu) |= mask;
 105
 106         /* enable the interrupt */
 107         set_eiem(cpu_eiem & per_cpu(local_ack_eiem, cpu));
 108 }
 109
 110 #ifdef CONFIG_SMP
 111 int cpu_check_affinity(struct irq_data *d, const struct cpumask *dest)
 112 {
 113         int cpu_dest;
 114
 115         /* timer and ipi have to always be received on all CPUs */
 116         if (irqd_is_per_cpu(d))
 117                 return -EINVAL;
 118
 119         /* whatever mask they set, we just allow one CPU */
 120         cpu_dest = first_cpu(*dest);
 121
 122         return cpu_dest;
 123 }
 124
 125 static int cpu_set_affinity_irq(struct irq_data *d, const struct cpumask *dest,
 126                                 bool force)
 127 {
 128         int cpu_dest;
 129
 130         cpu_dest = cpu_check_affinity(d, dest);
 131         if (cpu_dest < 0)
 132                 return -1;
 133
 134         cpumask_copy(d->affinity, dest);
 135
 136         return 0;
 137 }
 138 #endif
 139
 140 static struct irq_chip cpu_interrupt_type = {
 141         .name                   = "CPU",
 142         .irq_mask               = cpu_mask_irq,
 143         .irq_unmask             = cpu_unmask_irq,
 144         .irq_ack                = cpu_ack_irq,
 145         .irq_eoi                = cpu_eoi_irq,
 146 #ifdef CONFIG_SMP
 147         .irq_set_affinity       = cpu_set_affinity_irq,
 148 #endif
 149         /* XXX: Needs to be written.  We managed without it so far, but
 150          * we really ought to write it.
 151          */
 152         .irq_retrigger  = NULL,
 153 };
 154
 155 int show_interrupts(struct seq_file *p, void *v)
 156 {
 157         int i = *(loff_t *) v, j;
 158         unsigned long flags;
 159
 160         if (i == 0) {
 161                 seq_puts(p, "    ");
 162                 for_each_online_cpu(j)
 163                         seq_printf(p, "       CPU%d", j);
 164
 165 #ifdef PARISC_IRQ_CR16_COUNTS
 166                 seq_printf(p, " [min/avg/max] (CPU cycle counts)");
 167 #endif
 168                 seq_putc(p, '\n');
 169         }
 170
 171         if (i < NR_IRQS) {
 172                 struct irqaction *action;
 173
 174                 raw_spin_lock_irqsave(&irq_desc[i].lock, flags);
 175                 action = irq_desc[i].action;
 176                 if (!action)
 177                         goto skip;
 178                 seq_printf(p, "%3d: ", i);
 179 #ifdef CONFIG_SMP
 180                 for_each_online_cpu(j)
 181                         seq_printf(p, "%10u ", kstat_irqs_cpu(i, j));
 182 #else
 183                 seq_printf(p, "%10u ", kstat_irqs(i));
 184 #endif
 185
 186                 seq_printf(p, " %14s", irq_desc[i].irq_data.chip->name);
 187 #ifndef PARISC_IRQ_CR16_COUNTS
 188                 seq_printf(p, "  %s", action->name);
 189
 190                 while ((action = action->next))
 191                         seq_printf(p, ", %s", action->name);
 192 #else
 193                 for ( ;action; action = action->next) {
 194                         unsigned int k, avg, min, max;
 195
 196                         min = max = action->cr16_hist[0];
 197
 198                         for (avg = k = 0; k < PARISC_CR16_HIST_SIZE; k++) {
 199                                 int hist = action->cr16_hist[k];
 200
 201                                 if (hist) {
 202                                         avg += hist;
 203                                 } else
 204                                         break;
 205
 206                                 if (hist > max) max = hist;
 207                                 if (hist < min) min = hist;
 208                         }
 209
 210                         avg /= k;
 211                         seq_printf(p, " %s[%d/%d/%d]", action->name,
 212                                         min,avg,max);
 213                 }
 214 #endif
 215
 216                 seq_putc(p, '\n');
 217  skip:
 218                 raw_spin_unlock_irqrestore(&irq_desc[i].lock, flags);
 219         }
 220
 221         return 0;
 222 }
 223
 224
 225
 226 /*
 227 ** The following form a "set": Virtual IRQ, Transaction Address, Trans Data.
 228 ** Respectively, these map to IRQ region+EIRR, Processor HPA, EIRR bit.
 229 **
 230 ** To use txn_XXX() interfaces, get a Virtual IRQ first.
 231 ** Then use that to get the Transaction address and data.
 232 */
 233
 234 int cpu_claim_irq(unsigned int irq, struct irq_chip *type, void *data)
 235 {
 236         if (irq_desc[irq].action)
 237                 return -EBUSY;
 238         if (get_irq_chip(irq) != &cpu_interrupt_type)
 239                 return -EBUSY;
 240
 241         /* for iosapic interrupts */
 242         if (type) {
 243                 set_irq_chip_and_handler(irq, type, handle_percpu_irq);
 244                 set_irq_chip_data(irq, data);
 245                 __cpu_unmask_irq(irq);
 246         }
 247         return 0;
 248 }
 249
 250 int txn_claim_irq(int irq)
 251 {
 252         return cpu_claim_irq(irq, NULL, NULL) ? -1 : irq;
 253 }
 254
 255 /*
 256  * The bits_wide parameter accommodates the limitations of the HW/SW which
 257  * use these bits:
 258  * Legacy PA I/O (GSC/NIO): 5 bits (architected EIM register)
 259  * V-class (EPIC):          6 bits
 260  * N/L/A-class (iosapic):   8 bits
 261  * PCI 2.2 MSI:            16 bits
 262  * Some PCI devices:       32 bits (Symbios SCSI/ATM/HyperFabric)
 263  *
 264  * On the service provider side:
 265  * o PA 1.1 (and PA2.0 narrow mode)     5-bits (width of EIR register)
 266  * o PA 2.0 wide mode                   6-bits (per processor)
 267  * o IA64                               8-bits (0-256 total)
 268  *
 269  * So a Legacy PA I/O device on a PA 2.0 box can't use all the bits supported
 270  * by the processor...and the N/L-class I/O subsystem supports more bits than
 271  * PA2.0 has. The first case is the problem.
 272  */
 273 int txn_alloc_irq(unsigned int bits_wide)
 274 {
 275         int irq;
 276
 277         /* never return irq 0 cause that's the interval timer */
 278         for (irq = CPU_IRQ_BASE + 1; irq <= CPU_IRQ_MAX; irq++) {
 279                 if (cpu_claim_irq(irq, NULL, NULL) < 0)
 280                         continue;
 281                 if ((irq - CPU_IRQ_BASE) >= (1 << bits_wide))
 282                         continue;
 283                 return irq;
 284         }
 285
 286         /* unlikely, but be prepared */
 287         return -1;
 288 }
 289
 290
 291 unsigned long txn_affinity_addr(unsigned int irq, int cpu)
 292 {
 293 #ifdef CONFIG_SMP
 294         struct irq_data *d = irq_get_irq_data(irq);
 295         cpumask_copy(d->affinity, cpumask_of(cpu));
 296 #endif
 297
 298         return per_cpu(cpu_data, cpu).txn_addr;
 299 }
 300
 301
 302 unsigned long txn_alloc_addr(unsigned int virt_irq)
 303 {
 304         static int next_cpu = -1;
 305
 306         next_cpu++; /* assign to "next" CPU we want this bugger on */
 307
 308         /* validate entry */
 309         while ((next_cpu < nr_cpu_ids) &&
 310                 (!per_cpu(cpu_data, next_cpu).txn_addr ||
 311                  !cpu_online(next_cpu)))
 312                 next_cpu++;
 313
 314         if (next_cpu >= nr_cpu_ids)
 315                 next_cpu = 0;   /* nothing else, assign monarch */
 316
 317         return txn_affinity_addr(virt_irq, next_cpu);
 318 }
 319
 320
 321 unsigned int txn_alloc_data(unsigned int virt_irq)
 322 {
 323         return virt_irq - CPU_IRQ_BASE;
 324 }
 325
 326 static inline int eirr_to_irq(unsigned long eirr)
 327 {
 328         int bit = fls_long(eirr);
 329         return (BITS_PER_LONG - bit) + TIMER_IRQ;
 330 }
 331
 332 /* ONLY called from entry.S:intr_extint() */
 333 void do_cpu_irq_mask(struct pt_regs *regs)
 334 {
 335         struct pt_regs *old_regs;
 336         unsigned long eirr_val;
 337         int irq, cpu = smp_processor_id();
 338 #ifdef CONFIG_SMP
 339         struct irq_desc *desc;
 340         cpumask_t dest;
 341 #endif
 342
 343         old_regs = set_irq_regs(regs);
 344         local_irq_disable();
 345         irq_enter();
 346
 347         eirr_val = mfctl(23) & cpu_eiem & per_cpu(local_ack_eiem, cpu);
 348         if (!eirr_val)
 349                 goto set_out;
 350         irq = eirr_to_irq(eirr_val);
 351
 352 #ifdef CONFIG_SMP
 353         desc = irq_to_desc(irq);
 354         cpumask_copy(&dest, desc->irq_data.affinity);
 355         if (irqd_is_per_cpu(&desc->irq_data) &&
 356             !cpu_isset(smp_processor_id(), dest)) {
 357                 int cpu = first_cpu(dest);
 358
 359                 printk(KERN_DEBUG "redirecting irq %d from CPU %d to %d\n",
 360                        irq, smp_processor_id(), cpu);
 361                 gsc_writel(irq + CPU_IRQ_BASE,
 362                            per_cpu(cpu_data, cpu).hpa);
 363                 goto set_out;
 364         }
 365 #endif
 366         generic_handle_irq(irq);
 367
 368  out:
 369         irq_exit();
 370         set_irq_regs(old_regs);
 371         return;
 372
 373  set_out:
 374         set_eiem(cpu_eiem & per_cpu(local_ack_eiem, cpu));
 375         goto out;
 376 }
 377
 378 static struct irqaction timer_action = {
 379         .handler = timer_interrupt,
 380         .name = "timer",
 381         .flags = IRQF_DISABLED | IRQF_TIMER | IRQF_PERCPU | IRQF_IRQPOLL,
 382 };
 383
 384 #ifdef CONFIG_SMP
 385 static struct irqaction ipi_action = {
 386         .handler = ipi_interrupt,
 387         .name = "IPI",
 388         .flags = IRQF_DISABLED | IRQF_PERCPU,
 389 };
 390 #endif
 391
 392 static void claim_cpu_irqs(void)
 393 {
 394         int i;
 395         for (i = CPU_IRQ_BASE; i <= CPU_IRQ_MAX; i++) {
 396                 set_irq_chip_and_handler(i, &cpu_interrupt_type,
 397                                          handle_percpu_irq);
 398         }
 399
 400         set_irq_handler(TIMER_IRQ, handle_percpu_irq);
 401         setup_irq(TIMER_IRQ, &timer_action);
 402 #ifdef CONFIG_SMP
 403         set_irq_handler(IPI_IRQ, handle_percpu_irq);
 404         setup_irq(IPI_IRQ, &ipi_action);
 405 #endif
 406 }
 407
 408 void __init init_IRQ(void)
 409 {
 410         local_irq_disable();    /* PARANOID - should already be disabled */
 411         mtctl(~0UL, 23);        /* EIRR : clear all pending external intr */
 412         claim_cpu_irqs();
 413 #ifdef CONFIG_SMP
 414         if (!cpu_eiem)
 415                 cpu_eiem = EIEM_MASK(IPI_IRQ) | EIEM_MASK(TIMER_IRQ);
 416 #else
 417         cpu_eiem = EIEM_MASK(TIMER_IRQ);
 418 #endif
 419         set_eiem(cpu_eiem);     /* EIEM : enable all external intr */
 420
 421 }
 422