drivers/gpu/drm/nouveau/nv50_display.h

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  24  *
  25  */
  26
  27 #ifndef __NV50_DISPLAY_H__
  28 #define __NV50_DISPLAY_H__
  29
  30 #include "drmP.h"
  31 #include "drm.h"
  32 #include "nouveau_drv.h"
  33 #include "nouveau_dma.h"
  34 #include "nouveau_reg.h"
  35 #include "nouveau_crtc.h"
  36 #include "nv50_evo.h"
  37
  38 struct nv50_display_crtc {
  39         struct nouveau_channel *sync;
  40         struct {
  41                 struct nouveau_bo *bo;
  42                 u32 offset;
  43                 u16 value;
  44         } sem;
  45 };
  46
  47 struct nv50_display {
  48         struct nouveau_channel *master;
  49         struct nouveau_gpuobj *ntfy;
  50
  51         struct nv50_display_crtc crtc[2];
  52
  53         struct tasklet_struct tasklet;
  54         struct {
  55                 struct dcb_entry *dcb;
  56                 u16 script;
  57                 u32 pclk;
  58         } irq;
  59 };
  60
  61 static inline struct nv50_display *
  62 nv50_display(struct drm_device *dev)
  63 {
  64         struct drm_nouveau_private *dev_priv = dev->dev_private;
  65         return dev_priv->engine.display.priv;
  66 }
  67
  68 int nv50_display_early_init(struct drm_device *dev);
  69 void nv50_display_late_takedown(struct drm_device *dev);
  70 int nv50_display_create(struct drm_device *dev);
  71 int nv50_display_init(struct drm_device *dev);
  72 void nv50_display_destroy(struct drm_device *dev);
  73 int nv50_crtc_blank(struct nouveau_crtc *, bool blank);
  74 int nv50_crtc_set_clock(struct drm_device *, int head, int pclk);
  75
  76 int  nv50_display_flip_next(struct drm_crtc *, struct drm_framebuffer *,
  77                             struct nouveau_channel *chan);
  78 void nv50_display_flip_stop(struct drm_crtc *);
  79
  80 int  nv50_evo_init(struct drm_device *dev);
  81 void nv50_evo_fini(struct drm_device *dev);
  82 void nv50_evo_dmaobj_init(struct nouveau_gpuobj *, u32 memtype, u64 base,
  83                           u64 size);
  84 int  nv50_evo_dmaobj_new(struct nouveau_channel *, u32 handle, u32 memtype,
  85                          u64 base, u64 size, struct nouveau_gpuobj **);
  86
  87 #endif /* __NV50_DISPLAY_H__ */