drivers/gpu/drm/nouveau/nv04_pm.c

   1 /*
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   3  *
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  21  *
  22  * Authors: Ben Skeggs
  23  */
  24
  25 #include "drmP.h"
  26 #include "nouveau_drv.h"
  27 #include "nouveau_hw.h"
  28 #include "nouveau_pm.h"
  29
  30 struct nv04_pm_state {
  31         struct pll_lims pll;
  32         struct nouveau_pll_vals calc;
  33 };
  34
  35 int
  36 nv04_pm_clock_get(struct drm_device *dev, u32 id)
  37 {
  38         return nouveau_hw_get_clock(dev, id);
  39 }
  40
  41 void *
  42 nv04_pm_clock_pre(struct drm_device *dev, struct nouveau_pm_level *perflvl,
  43                   u32 id, int khz)
  44 {
  45         struct nv04_pm_state *state;
  46         int ret;
  47
  48         state = kzalloc(sizeof(*state), GFP_KERNEL);
  49         if (!state)
  50                 return ERR_PTR(-ENOMEM);
  51
  52         ret = get_pll_limits(dev, id, &state->pll);
  53         if (ret) {
  54                 kfree(state);
  55                 return (ret == -ENOENT) ? NULL : ERR_PTR(ret);
  56         }
  57
  58         ret = nouveau_calc_pll_mnp(dev, &state->pll, khz, &state->calc);
  59         if (!ret) {
  60                 kfree(state);
  61                 return ERR_PTR(-EINVAL);
  62         }
  63
  64         return state;
  65 }
  66
  67 void
  68 nv04_pm_clock_set(struct drm_device *dev, void *pre_state)
  69 {
  70         struct drm_nouveau_private *dev_priv = dev->dev_private;
  71         struct nv04_pm_state *state = pre_state;
  72         u32 reg = state->pll.reg;
  73
  74         /* thank the insane nouveau_hw_setpll() interface for this */
  75         if (dev_priv->card_type >= NV_40)
  76                 reg += 4;
  77
  78         nouveau_hw_setpll(dev, reg, &state->calc);
  79         kfree(state);
  80 }
  81