drivers/gpu/drm/nouveau/nouveau_dma.c

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  24  *
  25  */
  26
  27 #include "drmP.h"
  28 #include "drm.h"
  29 #include "nouveau_drv.h"
  30 #include "nouveau_dma.h"
  31
  32 void
  33 nouveau_dma_pre_init(struct nouveau_channel *chan)
  34 {
  35         chan->dma.max  = (chan->pushbuf_bo->bo.mem.size >> 2) - 2;
  36         chan->dma.put  = 0;
  37         chan->dma.cur  = chan->dma.put;
  38         chan->dma.free = chan->dma.max - chan->dma.cur;
  39 }
  40
  41 int
  42 nouveau_dma_init(struct nouveau_channel *chan)
  43 {
  44         struct drm_device *dev = chan->dev;
  45         struct drm_nouveau_private *dev_priv = dev->dev_private;
  46         struct nouveau_gpuobj *m2mf = NULL;
  47         struct nouveau_gpuobj *nvsw = NULL;
  48         int ret, i;
  49
  50         /* Create NV_MEMORY_TO_MEMORY_FORMAT for buffer moves */
  51         ret = nouveau_gpuobj_gr_new(chan, dev_priv->card_type < NV_50 ?
  52                                     0x0039 : 0x5039, &m2mf);
  53         if (ret)
  54                 return ret;
  55
  56         ret = nouveau_gpuobj_ref_add(dev, chan, NvM2MF, m2mf, NULL);
  57         if (ret)
  58                 return ret;
  59
  60         /* Create an NV_SW object for various sync purposes */
  61         ret = nouveau_gpuobj_sw_new(chan, NV_SW, &nvsw);
  62         if (ret)
  63                 return ret;
  64
  65         ret = nouveau_gpuobj_ref_add(dev, chan, NvSw, nvsw, NULL);
  66         if (ret)
  67                 return ret;
  68
  69         /* NV_MEMORY_TO_MEMORY_FORMAT requires a notifier object */
  70         ret = nouveau_notifier_alloc(chan, NvNotify0, 32, &chan->m2mf_ntfy);
  71         if (ret)
  72                 return ret;
  73
  74         /* Map push buffer */
  75         ret = nouveau_bo_map(chan->pushbuf_bo);
  76         if (ret)
  77                 return ret;
  78
  79         /* Map M2MF notifier object - fbcon. */
  80         if (drm_core_check_feature(dev, DRIVER_MODESET)) {
  81                 ret = nouveau_bo_map(chan->notifier_bo);
  82                 if (ret)
  83                         return ret;
  84         }
  85
  86         /* Insert NOPS for NOUVEAU_DMA_SKIPS */
  87         ret = RING_SPACE(chan, NOUVEAU_DMA_SKIPS);
  88         if (ret)
  89                 return ret;
  90
  91         for (i = 0; i < NOUVEAU_DMA_SKIPS; i++)
  92                 OUT_RING(chan, 0);
  93
  94         /* Initialise NV_MEMORY_TO_MEMORY_FORMAT */
  95         ret = RING_SPACE(chan, 4);
  96         if (ret)
  97                 return ret;
  98         BEGIN_RING(chan, NvSubM2MF, NV_MEMORY_TO_MEMORY_FORMAT_NAME, 1);
  99         OUT_RING(chan, NvM2MF);
 100         BEGIN_RING(chan, NvSubM2MF, NV_MEMORY_TO_MEMORY_FORMAT_DMA_NOTIFY, 1);
 101         OUT_RING(chan, NvNotify0);
 102
 103         /* Initialise NV_SW */
 104         ret = RING_SPACE(chan, 2);
 105         if (ret)
 106                 return ret;
 107         BEGIN_RING(chan, NvSubSw, 0, 1);
 108         OUT_RING(chan, NvSw);
 109
 110         /* Sit back and pray the channel works.. */
 111         FIRE_RING(chan);
 112
 113         return 0;
 114 }
 115
 116 void
 117 OUT_RINGp(struct nouveau_channel *chan, const void *data, unsigned nr_dwords)
 118 {
 119         bool is_iomem;
 120         u32 *mem = ttm_kmap_obj_virtual(&chan->pushbuf_bo->kmap, &is_iomem);
 121         mem = &mem[chan->dma.cur];
 122         if (is_iomem)
 123                 memcpy_toio((void __force __iomem *)mem, data, nr_dwords * 4);
 124         else
 125                 memcpy(mem, data, nr_dwords * 4);
 126         chan->dma.cur += nr_dwords;
 127 }
 128
 129 static inline bool
 130 READ_GET(struct nouveau_channel *chan, uint32_t *get)
 131 {
 132         uint32_t val;
 133
 134         val = nvchan_rd32(chan, chan->user_get);
 135         if (val < chan->pushbuf_base ||
 136             val > chan->pushbuf_base + (chan->dma.max << 2)) {
 137                 /* meaningless to dma_wait() except to know whether the
 138                  * GPU has stalled or not
 139                  */
 140                 *get = val;
 141                 return false;
 142         }
 143
 144         *get = (val - chan->pushbuf_base) >> 2;
 145         return true;
 146 }
 147
 148 int
 149 nouveau_dma_wait(struct nouveau_channel *chan, int size)
 150 {
 151         uint32_t get, prev_get = 0, cnt = 0;
 152         bool get_valid;
 153
 154         while (chan->dma.free < size) {
 155                 /* reset counter as long as GET is still advancing, this is
 156                  * to avoid misdetecting a GPU lockup if the GPU happens to
 157                  * just be processing an operation that takes a long time
 158                  */
 159                 get_valid = READ_GET(chan, &get);
 160                 if (get != prev_get) {
 161                         prev_get = get;
 162                         cnt = 0;
 163                 }
 164
 165                 if ((++cnt & 0xff) == 0) {
 166                         DRM_UDELAY(1);
 167                         if (cnt > 100000)
 168                                 return -EBUSY;
 169                 }
 170
 171                 /* loop until we have a usable GET pointer.  the value
 172                  * we read from the GPU may be outside the main ring if
 173                  * PFIFO is processing a buffer called from the main ring,
 174                  * discard these values until something sensible is seen.
 175                  *
 176                  * the other case we discard GET is while the GPU is fetching
 177                  * from the SKIPS area, so the code below doesn't have to deal
 178                  * with some fun corner cases.
 179                  */
 180                 if (!get_valid || get < NOUVEAU_DMA_SKIPS)
 181                         continue;
 182
 183                 if (get <= chan->dma.cur) {
 184                         /* engine is fetching behind us, or is completely
 185                          * idle (GET == PUT) so we have free space up until
 186                          * the end of the push buffer
 187                          *
 188                          * we can only hit that path once per call due to
 189                          * looping back to the beginning of the push buffer,
 190                          * we'll hit the fetching-ahead-of-us path from that
 191                          * point on.
 192                          *
 193                          * the *one* exception to that rule is if we read
 194                          * GET==PUT, in which case the below conditional will
 195                          * always succeed and break us out of the wait loop.
 196                          */
 197                         chan->dma.free = chan->dma.max - chan->dma.cur;
 198                         if (chan->dma.free >= size)
 199                                 break;
 200
 201                         /* not enough space left at the end of the push buffer,
 202                          * instruct the GPU to jump back to the start right
 203                          * after processing the currently pending commands.
 204                          */
 205                         OUT_RING(chan, chan->pushbuf_base | 0x20000000);
 206                         WRITE_PUT(NOUVEAU_DMA_SKIPS);
 207
 208                         /* we're now submitting commands at the start of
 209                          * the push buffer.
 210                          */
 211                         chan->dma.cur  =
 212                         chan->dma.put  = NOUVEAU_DMA_SKIPS;
 213                 }
 214
 215                 /* engine fetching ahead of us, we have space up until the
 216                  * current GET pointer.  the "- 1" is to ensure there's
 217                  * space left to emit a jump back to the beginning of the
 218                  * push buffer if we require it.  we can never get GET == PUT
 219                  * here, so this is safe.
 220                  */
 221                 chan->dma.free = get - chan->dma.cur - 1;
 222         }
 223
 224         return 0;
 225 }
 226